Artiq控制系統(tǒng)（清采比選20250084號）延期公告

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Artiq控制系統(tǒng)（清采比選***號）延期公告發(fā)布時間：***10 ngIf: publish.type.substring(0, 2) == "YQ" 延期信息延期理由：由于該項目報價***不滿足要求，本項目延期至***無 end ngIf: publish.type.substring(0, 2) == "YQ" ngIf: publish.type.substring(0, 2) == "BG" 采購項目名稱 Artiq控制系統(tǒng) 采購項目編號**** 公告截止時間****** 對外聯(lián)系人本項目不接受咨詢咨***道已聯(lián)系電話本項目不接受咨詢咨***道已簽約時間要求成交后10個工作日內(nèi) (如不按時簽訂合同，采購單位***) 交貨時間要求簽訂合同后50個工作日內(nèi) 采購單位 *** 最高限價***294.00 未公布國內(nèi)合同付款方式貨到付款100% ngIf: enquiry.foreignPayWay 國外合同付款方式貨到支付 end ngIf: enquiry.foreignPayWay 交貨地址 ***市*** 供應商特殊資質(zhì)要求符合《政府采購法》第二十二條規(guī)定的供應商基本條件 ngRepeat: qual in enquiry.quals 無公告說明 ngRepeat: item in enquiry.items 采購清單1 物資名稱采購數(shù)量計量單位所屬分類 Artiq控制系統(tǒng) 1 套 {{item.categoryName}} 無無品牌品牌1 型號品牌2 型號品牌3 型號單價***1,294.00 技術(shù)參數(shù)及配置要求該系統(tǒng)需要包含以下部分： 1.40個數(shù)字IO通道，32個模擬IO通道和12個DDS通道； 2.控制模塊（型號：1125 Processor “Kasli-SoC”）具體參數(shù)如下：（1）基于 Zynq-7000 CPU+FPGA 系統(tǒng)級芯片（2）在 1GHz Cortex-A9 CPU 上運行 ARTIQ 內(nèi)核（3）專用 RJ45 端口用于千兆以太網(wǎng) （4）4 個 SFP 12Gb/s 插槽用于 DRTIO （5）12 個 EEM 連接器（6）4 個 MMCX 時鐘輸出 3.數(shù)字IO模塊（型號：2128 SMA TTL card）具體參數(shù)如下：（1）8個TTL通道；（2）最小脈沖時間寬度：3ns 4.模擬IO模塊（型號：5528 SMA-IDC adapter）具體參數(shù)如下：（1）8個模***道； 5.DAC模塊（型號：5632 DAC “Fastino”）具體參數(shù)如下：（1）3***道DAC；（2）16比特精度；（3）所***道同時滿足2MSPS采樣率。 6.DDS模塊（型號：4410 DDS “Urukul”）具體參數(shù)如下：（1）4個采樣率為1 GS/s***道；（2）頻率分辨率約為0.25赫茲; （3）輸出頻率范圍：1MHz-400MHz；（4）最大輸出功率為 10 dBm；（5）數(shù)字步進衰減器范圍：0 至-31.5 dB；（6）RF開關(guān)-時間精度：1ns；隔離度：70dB {{tech.remark}} 質(zhì)保期 12個月 end ngRepeat: item in enquiry.items ****** 附件下載： ngRepeat: attach in publish.attach

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